石英晶体谐振器本身并不能产生振荡信号，而是需要与放大器和反馈网络组成完整的振荡电路。目前，大多数MCU、FPGA、DSP以及各种数字芯片内部采用的都是皮尔斯振荡器结构。对于工程师而言，仅仅选择合适频率的晶振还远远不够，还需要正确匹配负载电容、反馈电阻以及驱动能力，否则可能导致不起振、频率偏移、长期稳定性下降甚至晶体损坏。

什么是皮尔斯振荡器？

皮尔斯振荡器（Pierce Oscillator）是一种典型的并联晶体振荡电路，由石英晶体、反相放大器、反馈电阻以及两只负载电容组成。现代MCU通常已经将放大器集成在芯片内部，只需要外接晶体和少量外围器件即可构成完整的振荡电路，因此成为目前应用最广泛的晶振电路之一。

皮尔斯振荡器具有结构简单、稳定性高、外围元件少以及易于设计等特点，因此广泛应用于单片机、ARM处理器、FPGA、通信设备及各种嵌入式系统。

反馈电阻 Rf 的作用

皮尔斯振荡器内部通常采用CMOS反相器作为放大器。由于反相器本身不能直接驱动晶体工作，因此需要在输入端和输出端之间增加反馈电阻Rf，使反相器工作在线性放大区域，为晶体提供持续振荡所需的增益。如果没有反馈电阻，电路虽然有时能够起振，但容易出现以下问题：

起振困难

温度变化后停振

启动时间过长

工作稳定性下降

很多MCU已经将Rf集成在芯片内部，因此是否需要外接反馈电阻，应参考芯片规格书。

为什么要选择合适的负载电容？

负载电容（Load Capacitance，CL）是石英晶体最重要的参数之一，也是晶振选型时必须确认的指标。晶体规格书中标注的CL，是晶体正常工作时两端看到的等效负载电容。实际电路中的等效负载电容通常由两只外接电容C1、C2以及PCB寄生电容共同决定，其近似关系为：CL ≈ (C1 × C2) / (C1 + C2) + Cstray

其中，Cstray为PCB走线、芯片引脚等产生的寄生电容。如果实际CL与晶体标称值不一致，就会导致输出频率偏离标称频率，影响系统时钟精度。因此，在设计电路时，应根据晶体规格书提供的负载电容参数合理计算C1和C2的取值。

限流电阻 Rd 的作用

部分高速振荡电路会在晶体串联一个限流电阻Rd。其主要作用是降低晶体驱动功率（Drive Level），避免晶体长期工作在过高激励状态。如果驱动功率过高，可能导致：

晶体机械振幅过大

频率漂移增加

老化速度加快

晶体寿命缩短

严重时甚至停振

但Rd也不能过大，否则会降低振荡器增益，使晶体无法正常起振。因此，Rd通常需要根据驱动功率计算后确定是否需要增加。

激励功率（Drive Level）

激励功率表示晶体工作过程中实际承受的能量，一般单位为μW或mW。每一颗石英晶体规格书都会给出允许的最大Drive Level。如果实际驱动功率超过该数值，晶体可能长期处于过驱动状态，影响频率稳定性和使用寿命。

Drive Level通常可根据晶体电流以及等效串联电阻（ESR）进行计算：

Drive Level = Irms² × ESR

其中：Irms：流经晶体的均方根电流ESR：晶体等效串联电阻

设计时应确保实际Drive Level低于晶体规格书规定的最大值。

什么是增益裕量（Gain Margin）？

除了驱动功率外，晶振能否可靠起振，还取决于振荡器是否具有足够的增益裕量（Gain Margin）。增益裕量反映的是振荡器提供的负阻是否足够克服晶体损耗。计算增益裕量通常需要以下参数：

晶体ESR

静态电容C0

负载电容CL

工作频率F

MCU内部反相器跨导gm

其中：晶体参数可查阅晶体规格书；gm参数通常由MCU或芯片厂家提供。增益裕量越大，振荡器越容易可靠启动，同时具有更好的温度和老化裕量。一般建议设计时保留充足的启动裕量，以提高系统可靠性。

晶振选型与外围器件匹配建议

在设计皮尔斯振荡电路时，建议按照以下步骤进行晶振选型和外围器件匹配。

- 根据MCU或处理器规格书确认支持的晶体频率范围、最大ESR以及推荐负载电容。

- 根据晶体规格书提供的负载电容CL计算外部匹配电容C1和C2，并结合PCB寄生电容进行修正。

- 完成外围电路设计后，应进一步验证晶体的驱动功率是否低于规格书允许值。如果驱动功率过高，可适当增加串联限流电阻Rd，并重新评估振荡器的增益裕量，确保晶振既能够可靠起振，又不会因过驱动影响长期稳定性。

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